行为计数器设计_计数器的设计

本文目录一览：

• 1、为什么铃铛是计数器?
• 2、daytime计数器是什么?
• 3、multisim74ls192计数器原理是什么?
• 4、带异步复位,同步使能的十进制计数器的设计
• 5、如何用VHDL语言编写一个模为40,两位8421BCD码输出的减法计数器?
• 6、NBA的24秒计时器是怎样控制的?

为什么铃铛是计数器?

计数器一般的别在27颗后边，带铃的是计百位的，带杵的是计千位，夹子是计万位的。一般的情况下法器和金刚结的一般都要拴在念珠的3，7，21颗位置上。一般有子珠的五分之一或者五分之二大小，每一串十粒珠子，一般将这两串珠子称为记念，主要是用在长串的念珠上。

我们以一对计数器，一个卡子举例。计数器中一只做百位计，另外一只做千位计，卡子做万位计。 一般我们诵持的真言心咒都相对较短，佛珠一咒一珠，持佛珠诵咒一圈记数为100遍，此时百位计数器记子挪动一枚，代表一百遍。

计数器可以用来显示产品的工作状态，一般来说主要是用来表示产品已经完成了多少分的折页配页工作。它主要的指标在于计数器的位数，常见的有3位和4位的。很显然，3位数的计数器最大可以显示到999，4位数的最大可以显示到9999。

计数是一种最简单基本的运算。计数器就是实现这种运算的逻辑电路，计数器在数字系统中主要是对脉冲的个数进行计数，以实现测量，计数和控制的功能，同时兼有分频功能。

daytime计数器是什么?

1、计数器就是实现这种运算的逻辑电路，计数器在数字系统中主要是对脉冲的个数进行计数，以实现测量、计数和控制的功能，同时兼有分频功能，计数器是由基本的计数单元和一些控制门所组成，计数单元则由一系列具有存储信息功能的各类触发器构成，这些触发器有RS触发器、T触发器、D触发器及JK触发器等。

2、计数是一种最简单基本的运算。计数器就是实现这种运算的逻辑电路，计数器在数字系统中主要是对脉冲的个数进行计数，以实现测量，计数和控制的功能，同时兼有分频功能。

3、计数器（Counter）由基本的计数单元和控制门所组成，是在数字系统中对脉冲的个数进行计数，以实现测量、计数和控制功能，且兼有分频功能的仪器。

4、计数器是一种用于计数的装置，通常由一系列的数字或按钮组成，可以记录或显示数字的数量。在计数器上，可以按照顺序逐个计数，或者一次性累加计数。小学生使用的计数器有很多，例如，简单的机械式、电子式、虚拟计数器等。对于小学生使用的计数器，通常***用简单的机械式或电子式计数器。

5、计数器是什么样子？计数器由计数珠子、拱形金属杆、底座、挡板、数位顺序表等组成。计数器在数字系统中主要是对脉冲的个数进行计数。计数器是由基本的计数单元和一些控制门所组成，计数单元则由一系列具有存储信息功能的各类触发器构成。

6、要表示15，可以在十位上拨1个珠子，在个位上拨5个珠子，表示1个十和5个一，也就是15。计数器不仅仅可以表示20以内的数，它可以表示更大的数，最大可以表示110。十位上有10个珠子，就是10个十，也就是100，个位上也有10个珠子，就是10个一，也就是10，100+10=110。

multisim74ls192计数器原理是什么?

1、Multisim不熟练，用proteus做的，不过原理是一样的，见下图 MR正常情况是低电平，一旦为高电平，输出端就会清零，正是利用这一点做成的30进制计数器。

2、LS192是十进制加/减计数器，将CP脉冲接到UP端就是加法计数。利用计数到26产生复位回0。下图是proteus的仿真图，参照这个图就可以门长Multisim 画了。

3、原理框图：在数字电路设计的过程中具体的目的如下：1）巩固和加深对电子电路基本知识的理解，提高综合运用本课程所学知识的能力。2）培养根据设计需要选学参考书籍，查阅相关手册、图表和文献资料的自学能力，并掌握抢答器的基本原理，掌握4D锁存器、计数器、555定时器的工作原理和使用方法。

4、LS192芯片是一个具有双计数功能的芯片，既可以做加计数，也可以做减计数。

5、LS192是加/减计数器，你的接法是做减法计数器，正常情况下，你的接法是可以计数的。那检查这种毛病的方法是：首先确定是否为74LS192问题，可以接成加法计数器方式，看能否计数。

6、光耦 光耦合器（opticalcoupler equipment，英文缩写为OCEP）亦称光电隔离器或光电耦合器，简称光耦。它是以光为媒介来传输电信号的器件，通常把发光器（红外线发光二极管LED）与受光器（光敏半导体管，光敏电阻）封装在同一管壳内。

带异步复位,同步使能的十进制计数器的设计

1、LS161的11脚（Q3）和13脚（Q1）接到LS20的其中一个与非门的两个输入端，LS20是双4输入与非门，也就是一个与非门有四个输入端，所以另外两个输入端应该接高电平，把这个与非门的输出端接到LS161的CR非端（1脚）。输出就是一个十进制计数器了，计到10会自动清零。

2、用两片74LS160芯片设计一个同步六十进制计数器可使用同步级联、异步清零方式实现。其中个位计数为十进制形式。个位与十位计数器之间***用同步及连方式，个位计数器的进位信号连接到十位计数器的使能端EP，或ET，或EP、ET的并联，完成个位对十位计数器的进位控制。

3、实验内容：设计具有异步复位、同步使能的十进制计数器，其计数结果可以通过七段数码管、发光二极管等进行显示。

4、针对这个60进制，你可以用两个76161级联。个位上的芯片利用1001（9）时，的QAQD相与得到的，接到十位的CP输入端。这样实现进位。同时利用这个信号经过非门翻转后，接到同步预置LD上，DCBA预置为0000，实现计数到9，下一个CP进来时个位跳到0。

5、设计一个同步10进制计数器，需要两个触发器。一个触发器可以存储一位二进制数，因此两个触发器可以存储两位二进制数，即十进制数的每一位。在同步计数器中，每一位的计数值都由该位触发器的输出状态决定，因此需要两个触发器来实现10进制计数器的功能。

如何用VHDL语言编写一个模为40,两位8421BCD码输出的减法计数器?

设计四十进制的计数器，输出为8421BCD码，原图是用两片74LS90，只要删掉原图中的2输入与门即可，将原来的R0（1）复位端接到R0（2）上，其它不变。如下图所示。为了验证电路的正确，下图是用proteus 仿真的结果，是计数到最大数39时的截图。

VHDL语言实现 十进制同步减法计数器（异步清零、同步预置、下降沿触发、带借位输出BO端）。原程序如下，改程序已经通过仿真，仿真结果见图，输入D的值设为3，同步置位后，输出Q=D=3，功能实现。

改成QA，QB即可，其它就不用变了。其实，只要理解了计数原理，改成多少进制的，都可以举一反三，这样学习才能有收获。改后的逻辑图如下图 下面是仿真图，计数到最大数42时的截图 你用这个原图，提问过一个40进制的计数器， 也给你发过逻辑图和仿真图。这个提问，请及时***纳。

比如BCD码q（11 downto 0）可以表示0到999，前四位是个位，中四位是十位，后四位是百位。不知道对于溢出的有什么要求，我设成溢出后不做任何运算。

NBA的24秒计时器是怎样控制的?

计时电路递减计时，每隔1秒钟，计时器减1其中计数器和控制电路是系统的主要部分。计数器完成24秒计时功能，而控制电路完成计数器的直接清零、启动计数器、暂停/连续计数、译码显示电路的显示与灭灯、定时[_a***_]到报警等功能。当计时器递减计时到零（即定时时间到）时，显示器上显示00，同时发出光电报警信号。

碰篮筐的感应器肯定不对。。投空刷都不碰筐。是技术台那里专门有一个人控制，用眼睛看球入筐，按下手中的按钮，就变回24秒。

当比赛开始时，由主裁判员发出开始信号，计时器开始运行。此后，它将不断地计时，直到比赛结束。主裁判员可以在计时器上进行控制，以保证比赛的顺利进行。主裁判员可以使用计时器的暂停按钮，以暂停比赛的进行。当主裁判员按下暂停按钮时，比赛也会停止。此时，计时器会显示暂停的时间。

而是技术台的工作人员手动操作，他就是根据自己的眼睛来按下开关。三秒的判罚连计时器都没了，完全就是凭裁判的感觉。有时候站个五六秒都没问题，因为裁判根本没注意到他。一般是那种自己不醒目，也没有去防守很醒目的球员，也没有被很醒目的球员防守，也不是总是一个人站在三秒区里。

NBA赛场上，计时主要靠的是裁判组的核定，例如核对录像查看是否有出手过晚，24秒违例的现象，然后，经裁判组作出决定，再交由技术台，对时间进行改动，改动以0.1秒为单位。

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